MTJ素子数を削減し、消費電力と面積を低減
間欠的コンピューティングは、エナジーハーべスティングによる微量かつ不安定なエネルギー供給下における継続的なエッジ演算処理を可能にする。間欠的コンピューティングにおいては、頻発するエネルギー供給の停止前後における処理の継続性の確保が必須である。そのため、不揮発記憶回路（不揮発レジスタ）を活用し、ローカルなデータ転送のみで内部状態を不揮発記憶処理できる不揮発ロジック回路構造が有望な選択肢となる。 従来の不揮発レジスタは、1ビット記憶回路（不揮発フリップフロップ）をビット数分接続する構成であり、1ビットあたり2個のMTJ素子を必要とするため、面積やエネルギーのオーバーヘッドが大きいという課題があった。本発明は共有リファレンス方式と呼ぶ新たなレジスタ構成を提案する。本方式では、1ビットの情報を1つのMTJ素子とリファレンスMTJ素子の間で保持し、シーケンシャルなバックアップ・リストア処理を採用する。これにより、MTJ素子の数を削減し、回路機能を共有化することで、消費エネルギーを49%、面積を34%低減できることをシミュレーションにより確認した。
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