ウェビナ：FPGAデザインにおけるCDC検証の必要性

Windows/Linuxで動作可能なスタティックデザイン解析ツール

『ALINT-PRO』は、コーディングスタイルと命名規則、RTLと合成結果のシミュレーション不一致、スムーズで好適な合成、正しいFSM記述、 設計の後工程での問題、クロックおよびリセットツリーの問題、CDC、RDC、DFT、およびポータビリティと再利用のためのコーディングなどを中心に、VHDL、Verilog、SystemVerilogで記述されたRTLコードを解析する検証ソリューションです。 このソリューションは、RTLとSDC (Synopsys Design Constraints)ソースファイルをベースにスタティック解析を行い、デザインの早期段階で重大なデザインの問題点を見つけ出し、設計時間の大幅短縮に貢献します。 RTLシミュレーションおよび論理合成前にALINT-PROを実行すれば、デザイン上の問題をデザインフローの下流工程に波及する前に防ぎ、デザイン完成までに必要となる手戻りの回数を削減します。 ※詳しくはPDF資料をご覧いただくか、お気軽にお問い合わせ下さい。

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メタスタビリティの影響を受けないデザインを実現するために

クロックドメインクロッシング（CDC）の問題により、ASICおよびFPGAデバイスで多大な障害が発生しています。FPGAの複雑さと性能が向上するにつれて、CDCの問題がデザイン機能に与える影響はさらに大きくなっています。本紙では、CDCの問題とFPGAデザインのソリューションについて解説します。XilinxおよびIntel FPGAデバイスの実例とともに、さまざまなデザイン手法を紹介しています。 さらに重要なことに、本紙では信頼性の高いFPGAデザインの最も重要なCDCのガイドラインについてまとめています。

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スマート工場・スマート物流を実現するためのIoTソリューション、AI、FA／ロボットなどの最新技術・ソリューションが一堂に出展する専門展。 来場する製造業の製造・生産技術、工場・物流関係者と出展企業との商談・技術相談の場です。 弊社はアイトラッキンググラスの展示・実演を行います。

本セミナーでは、モバイルアプリの作成から社内システムとのデータ連携やデータ活用業務の自動化までをノーコードで簡単に実現できる「Platio Connect」をご紹介します。デモや、実際に業務効率化を実現された企業の事例についてもお伝えします。現場のデータを社内資産として有効活用したい方や、社内のデータを現場でも活用したい方、現場のDX推進にご関心のある方は、ぜひご視聴ください。

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